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南京理工大学

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近程目标探测雷达

朱晓华

B

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1.精通FPGA开发（Verilog/SystemVerilog），熟练使用VIVADO与GOWIN； 2.掌握AXI标准接口模块封装技术，熟练使用AXI接口； 3.掌握时序约束技能； 4.具备ZYNQ/MpSoc类型器件开发经验；5.具备光口/pcie/SRIO调试经验优先

顾老师 guchen@njust.edu.cn

研究生

硕士

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信息与通信工程/信号与信息处理

1年及以上工作经验、FPGA及上位机软件开发优先